業(yè)界FPGA低時延25G以太網(wǎng)IP誕生

2014年11月18日 11:32:59人氣：1906來源：

　　摘要：賽靈思公司宣布推出業(yè)界FPGA低時延25G以太網(wǎng)IP，用以解決數(shù)據(jù)中心應(yīng)用所面臨的吞吐量難題。
　　
　　低時延25G以太網(wǎng)MAC和PCSLogiCORE™IP解決方案不僅通過提供從10G到25G鏈路的遷移路徑幫助降低數(shù)據(jù)中心的資本支出，還能將架頂式(TOR)開關(guān)和服務(wù)器之間的前面板帶寬增加一倍以上(10G到25G)，從而大幅提升性能。此外，這種*的業(yè)界解決方案還支持新的25G以太網(wǎng)聯(lián)盟規(guī)范，與業(yè)界持續(xù)發(fā)展的新一代處理器保持同步發(fā)展，從而使得未來數(shù)據(jù)中心服務(wù)器的性能可以實(shí)現(xiàn)翻番。
　　
　　賽靈思將于11月17日至20日在美國路易斯安娜州新奧爾良市ErnestN.Morial會議中心舉行的2014年超算大會上展示25G以太網(wǎng)MAC和PCSLogiCOREIP解決方案，屆時歡迎蒞臨我們的3903號和4006號展臺。現(xiàn)場演示采用兩款Virtex®UltraScale™VCU107開發(fā)板，其使用5米長的直連銅線和兩個QSFP+模塊通過四通道25G以太網(wǎng)進(jìn)行通信。
　　
　　供貨情況
　　
　　25G以太網(wǎng)MAC和PCSLogiCOREIP解決方案現(xiàn)已向早期試用客戶供貨。

關(guān)鍵詞：處理器

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